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FPGA的静态功耗分析与降低技术

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摘要 FPGA已经被广泛用于实现大规模的数字电路和系统，随着CMOS工艺发展到深亚微米，芯片的静态功耗已成为关键挑战之一。文章首先对FPGA的结构和静态功耗在FPGA中的分布进行了介绍。接下来提出了晶体管的漏电流模型，并且重点对FPGA中漏电流单元亚阈值漏电流和栅漏电流进行了详细的分析。最后根据FPGA的特点采用双阈值电压晶体管，关键路径上的晶体管采用低闽值电压栅的晶体管，非关键路径上的晶体管采用高阈值电压栅的晶体管，以此来降低芯片的静态功耗。

DOI 0dpv3e3xd2/1202469

作者曹正州;曹靓

机构地区不详

出处《电子与封装》 2013年1期

关键词 FPGA 亚阈值漏电流布线开关双阈值电压

分类 [电子电信][物理电子学]

出版日期 2013年01月11日（中国期刊网平台首次上网日期，不代表论文的发表时间）

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电子与封装

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