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2007年11期
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基于ASIC的H.264编码器设计及其ADSP验证策略
基于ASIC的H.264编码器设计及其ADSP验证策略
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摘要
提出了H.264/AVC硬件编码器的一种3级流水结构,以此来提高硬件加速电路的处理能力和利用效率。鉴于H.264编码芯片验证的复杂性,还提出了一种基于ADSP-BF537的新型多媒体SoC验证平台,并讨论了如何利用BF537,对H.264编码芯片进行全面、高效的软硬件协同验证。
DOI
2d31xv7749/556791
作者
汪毅;林祖伦
机构地区
不详
出处
《中国集成电路》
2007年11期
关键词
H.264编码器
硬件加速器
ADSP-BF5
37
软硬件协同验证
SoC
分类
[电子电信][微电子学与固体电子学]
出版日期
2007年11月21日(中国期刊网平台首次上网日期,不代表论文的发表时间)
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来源期刊
中国集成电路
2007年11期
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