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BLE级FPGA布局实现及验证

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摘要布局是EDA流程中至关重要的环节,布局质量的好坏直接影响了其后的布线过程,乃至布线完成后整个电路的性能。传统的FPGA布局中以CLB为最小单元,一旦打包完成,CLB中的配置不再改变。实现了BLE级的FPGA布局,并把布局结果转换为XDL格式文件,使用Xilinx工具验证其正确性。

DOI 6jrn08wy45/1959339

作者惠锋;许慧;虞健;王新晨

机构地区不详

出处《电子与封装》 2018年4期

关键词 FPGA BLE 布局

分类 [电子电信][物理电子学]

出版日期 2018年04月14日（中国期刊网平台首次上网日期，不代表论文的发表时间）

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来源期刊

电子与封装

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